NEC TEST1 instruction (#4)
This commit is contained in:
@@ -1716,7 +1716,7 @@ execx86(int cycs)
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case 0x28: /* ROL4 r/m */
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case 0x28: /* ROL4 r/m */
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{
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{
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do_mod_rm();
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do_mod_rm();
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wait(22, 0);
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wait(21, 0);
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{
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{
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uint8_t temp_val = geteab();
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uint8_t temp_val = geteab();
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uint8_t temp_al = AL;
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uint8_t temp_al = AL;
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@@ -1735,7 +1735,7 @@ execx86(int cycs)
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case 0x2a: /* ROR4 r/m */
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case 0x2a: /* ROR4 r/m */
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{
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{
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do_mod_rm();
|
do_mod_rm();
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wait(22, 0);
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wait(21, 0);
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{
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{
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uint8_t temp_val = geteab();
|
uint8_t temp_val = geteab();
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uint8_t temp_al = AL;
|
uint8_t temp_al = AL;
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@@ -1748,6 +1748,22 @@ execx86(int cycs)
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handled = 1;
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handled = 1;
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break;
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break;
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}
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}
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case 0x10: /* TEST1 r8/m8, CL*/
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case 0x11: /* TEST1 r16/m16, CL*/
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case 0x18: /* TEST1 r8/m8, imm3 */
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case 0x19: /* TEST1 r16/m16, imm4 */
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{
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bits = 8 << (opcode & 0x1);
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do_mod_rm();
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wait(3, 0);
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{
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uint8_t bit = (opcode & 0x8) ? (pfq_fetchb() & 0x7) : (CL & 0xF);
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read_ea(0, bits);
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set_zf_ex(!(cpu_data & (1 << bit)));
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cpu_state.flags &= ~(V_FLAG | C_FLAG);
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}
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}
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default: {
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default: {
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opcode = orig_opcode;
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opcode = orig_opcode;
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break;
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break;
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